CY7C1460KV33-167AXC 是 3.3 V、1M × 36 同步流水線突發(fā) SRAM，分別采用 No Bus Latency? (NoBL?) 邏輯。它們設計用于支持無等待狀態(tài)的無限真正背靠背讀/寫操作。CY7C1460KV33-167AXC 器件配備了先進的 (NoBL) 邏輯，可在每個時鐘周期內(nèi)傳輸數(shù)據(jù)，實現(xiàn)連續(xù)讀/寫操作。

CY7C1460KV33-167AXC 的特性

引腳兼容，功能等同于零總線周轉(zhuǎn) (ZBT?)

支持零等待狀態(tài)下的 250-MHz 總線操作

可用速度等級為 250、200 和 167 MHz

內(nèi)部自定時輸出緩沖器控制，無需使用異步 OE

完全寄存（輸入和輸出），用于流水線操作

字節(jié)寫入功能

3.3 V 電源

3.3 V/2.5 V I/O 電源

時鐘到輸出時間短

2.5 ns（250 MHz 器件）

時鐘使能 (CEN) 引腳可暫停運行

同步自定時寫入

IEEE 1149.1 JTAG 兼容邊界掃描

突發(fā)能力線性或交錯突發(fā)順序

“ZZ "睡眠模式選項

片上糾錯碼 (ECC)，可降低軟錯誤率 (SER)

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